課程背景 xilinx(賽靈思) Spartan-6 FPGA 視頻處理培訓班 |
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xilinx(賽(sai)(sai)靈思) Spartan-6 FPGA對性(xing)能和靈活性(xing)進(jin)行(xing)了理想的(de)(de)(de)結合，可(ke)滿足標準和高(gao)分(fen)辨(bian)率(lv)圖像處(chu)(chu)理、視(shi)頻(pin)分(fen)析、多(duo)通(tong)道視(shi)頻(pin)編(bian)碼等方面的(de)(de)(de)要求，實現更(geng)快速更(geng)高(gao)效的(de)(de)(de)視(shi)頻(pin)傳輸(shu)。
利(li)用(yong)基于(yu)嵌(qian)入式DSP邏輯片實現的(de)(de)(de)高(gao)度(du)并行(xing)架構(gou)，基于(yu)xilinx(賽(sai)(sai)靈思) Spartan-6
FPGA開(kai)發的(de)(de)(de)系統能夠以全(quan)幀(zhen)速率(lv)處(chu)(chu)理原始(shi)分(fen)辨(bian)率(lv)的(de)(de)(de)圖像數據(ju)。 同時還可(ke)利(li)用(yong)經(jing)濟的(de)(de)(de)可(ke)定制MicroBlaze
軟處(chu)(chu)理器實現領先的(de)(de)(de)視(shi)頻(pin)分(fen)析功能。 Spartan-6 FPGA不僅支持這些先進(jin)功能，同時還比前一代解決方案成(cheng)本可(ke)降低多(duo)達(da)33%，采用(yong)先進(jin)的(de)(de)(de)功率(lv)管理和以太網供電技術(shu)，功耗也可(ke)降低多(duo)達(da)50%。 |
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課程目標 |
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培(pei)養學員迅(xun)速掌握(wo)和使(shi)用xilinx(賽靈(ling)思) Spartan-6進行(xing)工業級和消費方面(mian)的視頻開發，能進行(xing)視頻處理(li)方案的硬件設計，并且解決(jue)FPGA產品開發過程(cheng)中的常見(jian)問(wen)題，掌握(wo)基于Spartan-6的視頻處理(li)系(xi)統(tong)的設計和調試方法。 |
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培養對象 |
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FPGA系統的軟件和硬件開發工程(cheng)師；電子(zi)(zi)類專業的大(da)學生和研究生；電子(zi)(zi)產品設計愛好者。 |
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入學要求 |
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學員學習本課程應具備下列基礎知識：
◆電路系統的基本概念。 |
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班級規模及環境 |
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為了(le)保(bao)證培(pei)訓(xun)效(xiao)果，增加互動環節，我(wo)們(men)堅持小班(ban)授課，每期(qi)(qi)報(bao)名(ming)人數(shu)限3到5人，多(duo)余人員(yuan)安排到下一期(qi)(qi)進行。 |
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上課時間和地點 |
上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈
最近開課時間(周末班/連續班/晚班）：Spartan-6開課時間：2025年6月9日........ |
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學時 |
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質量保障 |
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1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
2、培訓結束后免費提供半年的技術支持，充分保證培訓后出效果；
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課程進度安排 |
課程大綱 |
| 第一(yi)階(jie)段 |
| Unit
1：Spartan-6 FPGA Overview
Unit 2： CLB Architecture
Unit 3: CLB Resources
Unit 4: Memory Resources
Unit 5: DSP Resources
Unit 6: Lab 2: DSP Resources
Unit 7: Basic I/O Resources
Unit 8: Spartan-6 FPGA I/O Resources
Unit 9: Lab 3: I/O Resources
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| 第二階段 |
| Unit 10: Basic Clocking
Resources
Unit 11: Spartan-6 FPGA Clocking Resources
Unit 12: Lab 4: Clocking Resources
Unit 13: Memory Controllers
Unit 14: HDL Coding Techniques
Unit 15: Lab 5: HDL Coding Techniques
Unit 16: Dedicated Hardware |
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